端口重复声明 工具误将systemverilog里的logic类型当作端口名字 如果DC工具使用analyze -format elaborate解析.v文件 就会不认识logic从而把他当成端口名 端口重复声明 工具误将systemverilog里的logic类型当作端口名字 如果DC工具使用analyze -format elaborate解析.v文件 就会不认识logic从而把他当成端口名 
DC综合时Warning：Redeclaration of port ‘xxxx’ VER-331
端口重复声明 工具误将systemverilog里的logic类型当作端口名字 如果DC工具使用analyze -format elaborate解析.v文件 就会不认识logic从而把他当成端口名 继续阅读 · 深度好文推荐
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